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数字逻辑

攻略

由于数字逻辑是学习计算机技术的一个重要基础，面对刚进入专业基础学习的二年级学生，他们对其基本工作原理和设计方法还不为了解，所以本课程要求学生掌握：首先从基本概念上建立起数字逻辑结构模型，然后能够进行基本常见数字器件（加法器、比较器、多路分配器等）的VERILOG设计开发工作。
在设计方法学上，本课程要求学生熟悉基于可编程超大规模集成电路设计上描述方法，其中重点掌握描述功能模块设计，并以微系统设计为目标来实现数字系统功能层集成能力。
作为当今EDA技术高速发展的时代，本课程从一种VERILOG的开放性平台出发，基于时序机理论技术描述了当前流行的硬件设计方法，正是因为这种设计方法的诞生，使得传统硬件设计和系统设计方法在质的方面有了飞跃的进步，这种设计方法囊括了当今数字系统应用环境和发展趋势，从而建立起如何将数字逻辑的理论基础与实际工程应用技术相结合起来，希望学生能够掌握VERILOG开发的基本流程（包含编辑、编译、测试、下载到FPGA板子上的全过程）。
最后在本课程中以一个真实应用工程示例为样本，熟悉并通过设计样本详细讨论了数字系统设计在实际工程中需要考虑的众多问题的全过程。

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